安徽DDR一致性测试DDR测试

克劳德高速数字信号测试实验室

DDR SDRAM即我们通常所说的DDR内存，DDR内存的发展已经经历了五代，目前 DDR4已经成为市场的主流，DDR5也开始进入市场。对于DDR总线来说，我们通常说的 速率是指其数据线上信号的快跳变速率。比如3200MT/s,对应的工作时钟速率是 1600MHz。3200MT/s只是指理想情况下每根数据线上比较高传输速率，由于在DDR总线 上会有读写间的状态转换时间、高阻态时间、总线刷新时间等，因此其实际的总线传输速率 达不到这个理想值。 完整的 DDR4调试、分析和一致性测试.安徽DDR一致性测试DDR测试

DDR总线上需要测试的参数高达上百个，而且还需要根据信号斜率进行复杂的查表修 正。为了提高DDR信号质量测试的效率，比较好使用御用的测试软件进行测试。使用自动 测试软件的优点是：自动化的设置向导避免连接和设置错误；优化的算法可以减少测试时 间；可以测试JEDEC规定的速率，也可以测试用户自定义的数据速率；自动读/写分离技 术简化了测试操作；能够多次测量并给出一个统计的结果；能够根据信号斜率自动计算建 立/保持时间的修正值。青海DDR一致性测试信号完整性测试用于 DDR、DDR2、DDR3、DDR4 调试和验证的总线解码器。

DDR系统设计过程，以及将实际的设计需求和DDR规范中的主要性能指标相结合，我们以一个实际的设计分析实例来说明，如何在一个DDR系统设计中，解读并使用DDR规范中的参数，应用到实际的系统设计中。某项目中，对DDR系统的功能模块细化框图。在这个系统中，对DDR的设计需求如下。

整个DDR功能模块由四个512MB的DDR芯片组成，选用Micron的DDR存诸芯片MT46V64M8BN-75。每个DDR芯片是8位数据宽度，构成32位宽的2GBDDR存诸单元，地址空间为Add<13..0>，分四个Bank，寻址信号为BA<1..0>。

通常测量眼图很有效的一种方法就是使用示波器的眼图测量功能，即用时钟做触发对数 据信号进行累积，看累积结果的差情况是否在可以容许的范围内。但遗憾的是，想用这种 方法直接测量DDR的信号质量非常困难，因为DDR信号读写时序是不一样的。

可以看到，写数据(DQ)的跳变位置对应着锁存信号(DQS)的中心，而 读数据的跳变位置却对应着锁存信号的边沿，而且在总线上还有三态，因此如果直接用DQS 触发对DQ累积进行眼图测量的话，会得到的结果。 DDR总线一致性测试对示波器带宽的要求；

DDR的信号探测技术

在DDR的信号测试中，还有 一 个要解决的问题是怎么找到相应的测试点进行信号探 测。由于DDR的信号不像PCle、SATA、USB等总线 一 样有标准的连接器，通常都是直接 的BGA颗粒焊接，而且JEDEC对信号规范的定义也都是在内存颗粒的BGA引脚上，这就 使得信号探测成为一个复杂的问题。

比如对于DIMM条的DDR信号质量测试来说，虽然在金手指上测试是方便的找到 测试点的方法，但是测得的信号通常不太准确。原因是DDR总线的速率比较高，而且可能 经过金手指后还有信号的分叉，这就造成金手指上的信号和内存颗粒引脚上的信号形状差异很大。 4代DDR之间有什么区别？青海DDR一致性测试信号完整性测试

快速 DDR4协议解码功能.安徽DDR一致性测试DDR测试

RDIMM(RegisteredDIMM,寄存器式双列直插内存)有额外的RCD(寄存器时钟驱动器，用来缓存来自内存控制器的地址/命令/控制信号等)用于改善信号质量，但额外寄存器的引入使得其延时和功耗较大。LRDIMM(LoadReducedDIMM,减载式双列直插内存)有额外的MB(内存缓冲，缓冲来自内存控制器的地址/命令/控制等),在技术实现上并未使用复杂寄存器，只是通过简单缓冲降低内存总线负载。RDIMM和LRDIMM通常应用在高性能、大容量的计算系统中。

综上可见，DDR内存的发展趋势是速率更高、封装更密、工作电压更低、信号调理技术 更复杂，这些都对设计和测试提出了更高的要求。为了从仿真、测试到功能测试阶段保证DDR信号的波形质量和时序裕量，需要更复杂、更的仿真、测试和分析工具。

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