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DS90UB947TRGCRQ1基本参数
  • 品牌
  • TI
  • 型号
  • DS90UB947TRGCRQ1
  • 封装形式
  • VQFN
DS90UB947TRGCRQ1企业商机

DS90UB947TRGCRQ1串行器,解串器。FPD-LinkIII串行总线特性:具有I2C兼容串行控制总线的双向控制接口通道接口支持高清(720p)数字视频格式支持RGB888+VS,HS,DE和I2S音频支持两个10位摄像机视频流支持5至85MHz并行时钟(PCLK)通过1.8V或3.3V兼容LVCMOSI/O接口实现3.3V单电源运行长达10米的AC耦合生成树协议(STP)互连并行LVCMOS视频输出具有嵌入式时钟的直流均衡和扰频数据支持中继器应用内部模式生成低功率模式至大限度地减少了功率耗散汽车应用级产品:符合AEC-Q1002级要求>8kV人体模型(HBM)和ISO10605静电放电(ESD)等级向下兼容至FPD-LinkII。自适应均衡器可优化大电缆范围。通过输出SSC生成(SSCG)和增强的渐进式转向(EPTO)功能使EMI至小化。四川销售DS90UB947TRGCRQ1分销商

DS90UB947TRGCRQ1断电(PDB),串行器有一个PDB输入引脚,用于启用或关闭设备。该引脚可以由外部设备控制,也可以通过VDDIO控制,其中VDDIO=1.71V至1.89V。为了节省电源,当不需要显示器时禁用链接(PDB=LOW)。确保在所有电源达到终电平之前,此引脚未被驱动为高电平。当PDB被驱动为低电平时,在释放或驱动为高电之前,确保引脚被驱动至0V至少3ms。在PDB直接上拉至VDDIO的情况下,需要一个10-kΩ的上拉电阻器和一个>10μF的电容器接地。将PDB切换为低电平将使设备断电,并将所有控制寄存器重置为默认值。在此期间,PDB必须保持低电平至少3ms,然后才能再次变高。四川进口DS90UB947TRGCRQ1供应商包含双向控制信道(BCC),该双向控制信道允许串行器/解串器以及远程I2C从设备之间的通信。

DS90UB947TRGCRQ1串行器,解串器的包装规范标准。芯片SKU是产品入库后一种编码归类方法,也是库存控制的至小单位。可以是以件,盒,托盘等为单位,每种产品均对应专门的SKU号,SKU号包含一种产品的品牌、型号、配置、等级、包装容量、单位、生产日期、保质期、用途、价格、产地等属性,一件产品的属性与其他产品都不一样,这样的商品就是一个单品。DS90UB947TRGCRQ1串行器,解串器FPD 链路 III,LVDS的包装有卷带(TR),剪切带(CT)。

在视频数据的发送端是FPD Link 串行器(TX)。串行器主要包括了视频接口、格式编码器、串行器、时钟电路、控制电路以及反向通道恢复电路,常见的视频接口有RGB、 OLDI、 HMDI、 DSI、 CSI、DP 等。一般一颗串行芯片只能支持一种视频接口,设计者需要根据SoC(IVI)或者Sensor/ISP(ADAS)提供的视频接口选择合适的串行芯片。视频接口为CSI-2,数据率为1.6Gbps/Lane, 一个CSI-2接口提供总共6.4Gbps的数据吞吐率,只要视频数据率低于这个至大吞吐率就可以被传输。DS90UB947TRGCRQ1是一款FPD-Link III 串行器。LVDS接口主要将RGB TTL信号按照SPWG/JEIDA格式转换成LVDS信号进行传输。DS90UB947TRGCRQ1即是。

DS90UB947TRGCRQ1反向通道SPI操作在反向通道SPI操作中,解串器将从选择(SS)、SPI时钟(SCLK)采样到内部振荡器时钟域。此外,在检测到活动SPI时钟边沿时,解串器对SPI数据(MOSI)进行采样。SPI数据样本存储在缓冲区中,以便通过反向通道传递给串行器。反序列化器在反向通道帧中将SPI信息发送到序列化器。在每个反向通道帧中,解串器发送“从选择”值的指示。从选择应至少在一个后通道帧周期内处于非活动状态(高),以确保传播到串行器。因为数据是在单独的后信道帧中传递和缓冲的,所以数据可以在突发中重新生成。首帧帧传递SS活动指示,第二帧传递首三个数据位,第三帧传递附加数据位。SERDES用在物理层与物理层通信,简单来说就是把低速并行信号转化为高速串行信号。上海销售DS90UB947TRGCRQ1价格优惠

串行/解串器不但在光纤数据传播中起重要作用,在短距离芯片互联中同样起着重要作用。四川销售DS90UB947TRGCRQ1分销商

Serializer/Deserializer的实现采用双沿(DDR)的工作方式,利用面积换速度的策略,降低了电路中高频率电路的比例,从而降低了电路的噪声。接收方向除了Deserializer之外,一般带有还有对齐功能逻辑(Aligner)。相对SerDes发送端,SerDes接收端起始工作的时刻是任意的,接收器正确接收的 bit可能是发送并行数据的任意bit位置。因此需要对齐逻辑来判断从什么bit位置开始,以组成正确的并行数据。对齐逻辑通过在串行数据流中搜索特征码字(Alignment Code)来决定串并转换的起始位置。比如8B/10B编码的协议通常用K28.5来作为对齐字。通过滑窗,逐bit比对,以找到对齐码(Align-Code)的位置,经过多次在相同的位置找到对齐码之后,状态机锁定位置并选择相应的位置输出对齐数据。DS90UB947TRGCRQ1串行器,解串器,输入类型是HDMI,输出类型FPD 链路 III,LVDS。四川销售DS90UB947TRGCRQ1分销商

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中国香港质量DS90UB947TRGCRQ1分销商 2023-10-10

TDM格式,有些IC支持使用一个公共时钟的多路I2S数据输入或输出,但这样的方法显然会增加数据传输所需要的管脚数量。当同一个数据线上传输两个以上通道的数据时,就要使用TDM格式。TDM数据流可以承载多达16通道的数据,并有一个类似于I2S的数据/时钟结构。每个通道的数据都使用数据总线上的一个槽(Slot),其宽度相当于帧的1/N, 其中N是传输通道的数量。出于实用考虑,N通常四舍五入到相近的2次幂(2、4、8、或16),并且任何多余通道都被空闲。一个TDM帧时钟通常实现为一位宽的脉冲,这与I2S的50%占空比时钟相反。超过25 MHz的时钟速率通常不用于TDM数据,原因是较高的频率会引起印刷电...

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